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ZR-EP1C6/EP1C12 SOPC核心板

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ZR-EP1C6/EP1C12 SOPC核心板(图1)

一、系统环境(WIN2000、XP) 基于QuartusII和NiosII的SOPC系统设计; SOPC Buider(定制处置整理器及外设连接口); NiosII IDE(系统包括研发环境);
二、SOPC核心板简介

由于FPGA与存储器直接实行高速数值交换。所以成在很多干扰因素,因此这也是很多 研发板速度很难提升的关键原因。所以我们在设计的时候尽量靠近FPGA芯片。这样就*大限度减少因为布板所造成的干扰因素。 我们的研发板的SDRAM和FLASH应用单独的总线.这样就为初学者提供了更加方面灵活的设计途径.同时研发板应用了独特的跳线设计方法,可以在一块 PCB板上使用EP1C6和EP1C12两种不一样容量(KV)的FPGA芯片,用户在实行设计的时候如果感觉资源不够可以 选用大容量(KV)的FPGA芯片. 1。支持EPCS1EPCS4
EP1C6选用EPCS1配备芯片,EP1C12选用EPCS1配备芯片。 216M Byte 高速SDRAM
一片4M×32Bit SDRAM ,*高133MHz读写速度;MT48LC4M32B 32M Byte 通用型FLASH 可以升级到4M BYTE
一片1M×16bit(64Mbit) AM29LV160,90ns读写速度; 可以配备为16位或8位模式.
灵活的页面方法,可以用来存储FPGA配备文件或者实操系统镜像文件; 4、板上载有一个50M有源晶振。 由于EP1C6QC240C8芯片*高运行频率80M。50M频率是可以适用大多数应用的,由于我们没有将晶振直接焊接在板上。而是经过晶振插头座,所以用户能够便利的按照使用情况,更换不一样频率晶振。板上全部GCLK全部已经引出。如果和我们的EDA3.2主板实行搭配连接,这样就可以拥有5个以上的时钟 源,并而且可以便利的更换不一样时钟频率。
程序表单
HDL实训程序表单
1 UART_IN_HDL 用HDL语言写的串行口通讯程序
2 LCD1602 一个LCD1602的显露试验程序.
5 PS2_LCD ps/2键盘写入,PS2键盘写入lcd上显露写入的字符实训
6 PS2_RS232 完成PS/2连接口与RS-232连接口的数值传输,
7 light 彩灯控制实训 实训平台上的8个LED完成常见彩灯实训。
8 SRAM_TEST HSNIOS1C板上的SRAM实训程序
9 LED 板上面的LED控制程序。
NIOS部分实训程序
1 LCD_FLASH 一个用NIOS写的完整的LCD演示程序.并而且程序可以下载到FLASH内运行.
2 UART_IN_NIOS 用NIOS写的研发板到PC RS232通讯实训程序
3 TESTALL 用NIOS写的系统全检程序
4 SEG7LED 板上的LED和数码管显露实训程序.
5 ST_UCLINUX 一个标准Uclinux工程实训


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